1.Relevance of Grooved NMOSFETS in Ultra Deep Submicron Region in Low Power Applications

作　　者：Subhra Dhar ;Manisha Pattanaik

出　　处：International Journal of VLSI Design & Communication Systems. 2011 ;2(3).

出版社：Academy & Industry Research Collaboration Center (AIRCC)

文章 ID：86826326

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2.Design and Analysis of a Novel Low-Power SRAM Bit-Cell Structure at Deep-Sub-Micron CMOS Technology for Mobile Multimedia Applications

作　　者：Neeraj kr Shukla ;R.K.Singh ;Manisha Pattanaik

出　　处：International Journal of Advanced Computer Science and Applications(IJACSA). 2011 ;2(5).doi:10.14569/IJACSA.2011.020507

出版社：Science and Information Society (SAI)

文章 ID：111489628

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3.Impact of Parameter Variations and Optimization on DG-PNIN Tunnel FET

作　　者：Priya Jhalani ;Manisha Pattanaik

出　　处：International Journal of VLSI Design & Communication Systems. 2014 ;5(3):47.doi:10.5121/vlsic.2014.5305

出版社：Academy & Industry Research Collaboration Center (AIRCC)

文章 ID：216765060

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4.Analysis of Pocket Double Gate Tunnel FET for Low Stand by Power Logic Circuits

作　　者：Kamal K. Jha ;Manisha Pattanaik

出　　处：International Journal of VLSI Design & Communication Systems. 2013 ;4(6):27-34.doi:10.5121/vlsic.2013.4603

出版社：Academy & Industry Research Collaboration Center (AIRCC)

文章 ID：218558875

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	Manisha Pattanaik	4篇
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	R.K.Singh	1篇

	International Journal of VLSI Design & Communication Systems	3篇
	International Journal of Advanced Computer Science and Applications(IJACSA)	1篇

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